Подписка на новости

Опрос

Нужны ли комментарии к статьям? Комментировали бы вы?

Реклама

 

2006 №4

Микросхемы ФАПЧ и синтезаторы на их основе производства фирмы Analog Devices

Михалев Павел


Фазовая автоподстройка частоты (ФАПЧ) широко используется в радиотехнических устройствах и системах связи. На основе генераторов, управляемых напряжением (ГУН), и схем ФАПЧ строят синтезаторы частоты, которые позволяют получить сетку стабильных частот. Одним из применений синтезаторов является использование их в качестве опорных генераторов в преобразователях радиочастотных сигналов. В статье рассматриваются принципы ФАПЧ и структура синтезаторов на их основе. Приводятся сведения о микросхемах таких устройств, выпускаемых фирмой Analog Devices.

Фазовая автоподстройка частоты

Схема ФАПЧ (английский эквивалент Phase-Locked Loop — PLL) представляет собой систему с контуром обратной связи, который содержит ГУН, фазовый детектор (ФД), фильтр нижних частот (ФНЧ) и усилитель (рис. 1).

Рис. 1. Структурная схема ФАПЧ
Рис. 1. Структурная схема ФАПЧ

ФД (или детектор ошибки) сравнивает фазы сигнала опорного генератора VREF и выходного сигнала ГУН V0 и вырабатывает напряжение V1, величина которого зависит от разности фаз этих сигналов. Если эта разность равна φ радиан, то выходное напряжение ФД будет определяться выражением:

(1)

где Kφ — коэффициент передачи «фаза → напряжение ФД» размерностью В/рад.

Выходное напряжение ФД пропускается через ФНЧ для подавления высокочастотных составляющих и их гармоник, которые присутствуют в опорном сигнале и на выходе ГУН. Напряжение с выхода ФНЧ усиливается и используется как управляющее для ГУН (VC). Величина его составляет:

(2)

где А — коэффициент усиления усилителя.

Такое управляющее напряжение обеспечивает изменение частоты ГУН по отношению к частоте его собственных колебаний f0 до уровня

(3)

где KV — коэффициент передачи «напряжение → частота ГУН» размерностью Гц/В.

Когда осуществлен захват опорного сигнала fОП схемой ФАПЧ, справедливо равенство:

Поскольку согласно (3):

получим:

(4)

Таким образом, если схема ФАПЧ захватила опорный сигнал, то сдвиг по фазе между этим сигналом и выходным сигналом ГУН устанавливается равным φ, и две частоты fREF и f0 будут точно синхронизированы.

Максимальное напряжение на выходе ФД имеет место при φ = π и φ = 0 и определяется выражением:

(5)

Соответствующее максимально возможное управляющее напряжение равно:

(6)

В этом случае диапазон частот, который можно обеспечить на выходе ГУН, составляет:

Следовательно, максимальный частотный диапазон сигналов опорного генератора, при которых схема ФАПЧ будет находиться в режиме захвата, составляет:

Величина 2ΔfL называется полосой захвата ФАПЧ и определяется по формуле:

Следует отметить, что полоса захвата симметрична по отношению к частоте собственных колебаний ГУН f0. На рис. 2 приведена зависимость VC от частоты опорного сигнала, характеризующая полосу захвата. Вне этой полосы частота ГУН не может быть синхронизирована с частотой опорного сигнала.

Рис. 2. Полоса захвата ФАПЧ
Рис. 2. Полоса захвата ФАПЧ

Схемотехника ФАПЧ может быть классифицирована по методу реализации [1].

Если в качестве ФД используется линейный элемент типа четырехквадрантного перемножителя, а остальные элементы контура являются линейными аналоговыми, ФАПЧ называется линейной (linear PLL — LPLL).

Если используется цифровой ФД, а остальные элементы контура ФАПЧ являются линейными аналоговыми, то ФАПЧ называется цифровой (digital PLL — DPLL).

Если ФАПЧ строится исключительно из цифровых блоков, без использования каких-либо пассивных или линейных аналоговых элементов, то ФАПЧ называется полностью цифровой (all digital PLL — ADPLL).

Как и любая цифровая система, полностью цифровая ФАПЧ может быть реализована в виде программы. В этом случае ФАПЧ называется программно реализованной (soft PLL — SPLL).

К основным параметрам ФАПЧ относят фазовый шум, уровень проникновения гармоник опорного сигнала и время захвата.

Фазовый шум порождается малыми флуктуациями случайного характера фазы сигнала опорного генератора. Наличие его на входе ФД приводит к появлению ошибки на его выходе и, как следствие, к нестабильности частоты выходного сигнала ГУН.

Время захвата ФАПЧ это время от момента подачи сигналов на входы ФД до момента возникновения установившегося режима (момента захвата).

Синтезатор частоты с ФАПЧ

Схема ФАПЧ используется в качестве основного элемента при построении синтезаторов частоты, которые вырабатывают сетку высокостабильных частот, кратных частоте опорного генератора. Для обеспечения высокой стабильности используют опорный генератор с кварцевым резонатором. Структура такого синтезатора приведена на рис. 3.

Рис. 3. Структурная схема синтезатора частоты с ФАПЧ
Рис. 3. Структурная схема синтезатора частоты с ФАПЧ

Частота опорного генератора fОП делится на целое число R с помощью входного делителя. На его выходе вырабатывается сигнал с частотой fREF/R. Частота ГУН также делится на целое число N при помощи делителя в петле ФАПЧ, принимая значения f0/N. Когда схема ФАПЧ работает в режиме захвата опорного сигнала, имеет место равенство:

Откуда:

Для получения различных коэффициентов деления применяют программируемые делители. Тем самым обеспечивается широкий спектр выходных частот синтезатора, кратных частоте опорного сигнала. Диапазон выходных частот синтезатора определяется полосой захвата ФАПЧ, а абсолютные значения границ этого диапазона зависят от собственной частоты ГУН, относительно которой располагается полоса захвата (рис. 2). Величина шага изменения частоты синтезатора Δf (разрешающая способность синтезатора) в пределах диапазона его перестройки зависит от величины коэффициента деления делителя N и от времени захвата ФАПЧ. При уменьшении Δf требуется уменьшение времени захвата (времени установления), то есть уменьшение времени перехода от одного устойчивого состояния с частотой f01 до другого устойчивого состояния с частотой f02 = f01±Δf

Уменьшить время захвата можно за счет увеличения полосы пропускания петлевого ФНЧ. Но это приводит к увеличению уровней фазовых шумов и побочных гармоник. При значительном увеличении границы полосы пропускания фильтра (более 0,2(fREF/R)) петля ФАПЧ может стать нестабильной и неспособной к захвату. Для исключения этого необходимый запас по фазе в петле ФАПЧ должен составлять не менее 45°.

Большое значение коэффициента деления N в петле ФАПЧ может повлечь за собой появление некоторых нежелательных эффектов:

  1. Коэффициент передачи контура ФАПЧ уменьшается с ростом N, что замедляет ответную реакцию на любые изменения на входе.
  2. Для заданной величины фазового шума сигнала опорного генератора в полосе пропускания контура ФАПЧ фазовый шум выходного сигнала составляет N/R от величины входного. Если N = R и помехи появляются на входе схемы, то это не скажется при любых отклонениях фаз сигналов на входе детектора. Однако если помехи возникают на входе ФД (до деления на R), то коэффициент усиления выходного фазового шума имеет значение N.

Из этого следует, что больших значений коэффициентов деления в петле ФАПЧ надо по возможности избегать. Уменьшение N можно «компенсировать» увеличением частоты опорного генератора fREF . Увеличение fREF и, как следствие, увеличение частоты на входе ФД (fREF/R), позволяет уменьшить уровень фазовых шумов синтезатора [2].

В зависимости от значения коэффициента деления N делителя петли ФАПЧ различают ФАПЧ с целочисленным коэффициентом деления (Integer-N PLL) и ФАПЧ с дробным коэффициентом деления (Fractional-N PLL). ФАПЧ с малым временем установления относится к категории быстродействующих (Fast Settling PLL).

Разрешающая способность синтезатора с целочисленным коэффициентом деления N делителя в петле ФАПЧ ограничена величиной fREF/R. При дробном коэффициенте деления N разрешающая способность может составлять доли от величины fREF/R. Другим достоинством систем с дробным коэффициентом деления является уменьшение времени захвата. Например, если fREF/R = 20 МГц и полоса пропускания ФНЧ составляет 150 кГц, то перестройка синтезатора по частоте на 30 МГц будет занимать менее 30 мкс.

В современных синтезаторах время захвата мало, но конечно, что определяется возможностями схемотехники. В ряде случаев, когда требуется повышенное быстродействие системы при переходе от одной частоты к другой, используют два синтезатора: пока один работает на данной частоте в течение времени, большее, чем время захвата, второй синтезатор переключается на другую требуемую частоту. В результате время перехода от одной частоты к другой определяется только временем коммутации выходов синтезаторов.

Микросхемы ФАПЧ производства Analog Devices

Компания Analog Devices выпускает широкий спектр микросхем (МС) ФАПЧ и синтезаторов на основе ФАПЧ. МС ФАПЧ содержат детектор ошибки и два делителя (R и N) с программируемыми коэффициентами деления и ориентированы на применение в схемах высокостабильных перестраиваемых генераторов, устройствах синхронизации и синтезаторах при использовании внешних генераторов (опорного и ГУН) и петлевого ФНЧ. По-видимому, это дало разработчикам основание называть такие микросхемы синтезаторами (PLL Synthesizer), что, вообще говоря, не вполне корректно. Программирование делителей осуществляется, как правило, через единый интерфейс.

Таблица 1. Микросхемы ФАПЧ Analog Device
Таблица 1. Микросхемы ФАПЧ Analog Device
Таблица 2. Микросхемы сдвоенных ФАПЧ Analog Device
Таблица 2. Микросхемы сдвоенных ФАПЧ Analog Device

Номенклатура МС ФАПЧ по данным на конец 2005 года [3] приведена в таблице 1. Устройства различаются по частотным диапазонам сигналов опорного генератора и ГУН, уровню фазовых шумов и типу делителей в петле ФАПЧ (N), а также по входу опорного генератора (R). Кроме того, выпускаются микросхемы двухканальных ФАПЧ, которые приведены в таблице 2. В промышленно выпускаемых микросхемах используется цифровой детектор ошибки () с выходом по току, где выходной генератор реализован в виде зарядовой помпы (charge pump — CP). Упрощенная схема такого PFD приведена на рис. 4.

Рис. 4. Упрощенная схема цифрового PFD с зарядовой помпой
Рис. 4. Упрощенная схема цифрового PFD с зарядовой помпой

Подобная реализация PFD обладает рядом преимуществ по сравнению с классическим детектором с выходом по напряжению: большая линейность, низкая стоимость.

ADF4001 относится к категории низкочастотных ФАПЧ и предназначена для работы в схемах тактовых генераторов с ФАПЧ, работающих в диапазоне до 200 МГц. Делители с программируемыми целочисленными коэффициентами деления (R = 1–16383 и N = 1–8191) позволяют получить широчайший спектр выходных частот на выходе внешнего ГУН.

Рис. 5. Структурная схема трехчастотного тактового генератора с использованием МС ADF4001
Рис. 5. Структурная схема трехчастотного тактового генератора с использованием МС ADF4001

На рис. 5 приведен пример применения МС ADF4001 в схеме трехчастотного генератора синхронизированных тактовых сигналов.

На этой схеме опорный генератор обозначен как Master Clock, а ГУН — как VCXO — ГУН с кварцевым резонатором.

ADF4007 классифицируется производителем как высокочастотный делитель и синтезатор частоты. Максимальное значение частоты ГУН определяется величиной 7,5 ГГц. Однако коэффициент деления делителя петли ФАПЧ ограничен конечным набором значений N = 8, 16, 32, 64, а входной делитель имеет фиксированный коэффициент деления R = 2. Фазовый шум существенно ниже, чем у ADF4001 и составляет всего –219 дБм/Гц.

Рис. 6. Структурная схема семейства ADF4110/4111/4112/4113
Рис. 6. Структурная схема семейства ADF4110/4111/4112/4113

ADF4110/4111/4123/4113 — семейство МС, реализованных по единой структурной схеме (рис. 6) и различающихся частотным диапазоном применяемого ГУН (табл. 1). Диапазон допустимых частот опорного генератора у всех микросхем одинаков и составляет 5–104 МГц.

Отличительной особенностью схемотехники данных МС является петлевой делитель, который реализован по схеме, приведенной на рис. 7.

Рис. 7. Блок-схема петлевого делителя
Рис. 7. Блок-схема петлевого делителя

Данная схема содержит предварительный делитель частоты (prescaler), свойства которого определяются двухкоэффициентным параметром Р/(Р+1). Величина этого параметра устанавливается равной 8/9 (Р = 8), 16/17 (Р = 16), 32/33 (Р = 32) или 64/65 (Р = 64). Эти значения определяются условием синхронизации с частотой (4/5)f0. Коэффициенты деления счетчиков A и B могут принимать значения в пределах: А = 0–63, В = 3–8191. Результирующий коэффициент деления определяется соотношением: N = BP + A. В результате диапазон целых значений N существенно расширяется.

Предварительный делитель работает при значении выходной частоты не более 200 МГц. Имеется опция установки режима работы зарядовой помпы.

Микросхемы данного семейства по выводам совместимы с ADF4001.

ADF4106/4107 имеют аналогичную с предыдущими МС структуру (рис. 6). Они отличаются более высокой частотой применяемого ГУН и, соответственно, большей частотой опорного генератора, а также меньшим напряжением питания (табл. 1). Предварительный делитель работает при значении выходной частоты не более 325 МГц.

ADF4116/ADF4117/ADF4118 — семейство, реализованное по сходной с предыдущими МС структуре. Отличие заключается в отсутствии опции установки режима зарядовой помпы. Параметр предварительного делителя составляет Р/(Р+1) = 8/9 для ADF4116 и Р/(Р+1) = 32/33 для ADF4117/4118. Коэффициенты деления счетчиков A и B могут принимать значения в пределах 0–31 и 3–8191 соответственно. Данные МС характеризуются меньшим током потребления.

ADF4153 открывает серию МС с дробным коэффициентом деления делителя в петле ФАПЧ, который повышает разрешающую способность ФАПЧ по частоте. Структурная схема приведена на рис. 8.

Рис. 8. Структурная схема ADF4153
Рис. 8. Структурная схема ADF4153

Петлевой делитель реализован по схеме рис. 9.

Рис. 9. Структурная схема дробного делителя петли ФАПЧ
Рис. 9. Структурная схема дробного делителя петли ФАПЧ

Коэффициент деления такого делителя определяется тремя устанавливаемыми параметрами INT, MOD и FRAC, которые для данной реализации могут принимать значения 31–511, 2–4095 и 0–(MOD–1) соответственно. Результирующий коэффициент дробного делителя петли ФАПЧ определяется соотношением:

Дополнительно разрешающая способность повышается за счет включения переключаемого умножителя (doubler — D) с коэффициентом D, который равен 0 или 1 на входе делителя R (рис. 8). Результирующий коэффициент деления входного делителя RIN получается равным:

где величина R для данного варианта схемы может принимать значения в пределах 1–15.

Данная МС совместима по выводам с ADF4110/4111/4112/4113 и ADF4106. Имеет опцию установки режима работы зарядовой помпы.

ADF4154 в целом аналогична ADF4153 за тем исключением, что в данном случае предварительный делитель делителя петли ФАПЧ имеет только два значения устанавливаемого параметра: 4/5 и 8/9. Совместима по выводам с ADF4110/4111/4112/4113/4106 и ADF4153.

ADF4156 представляет собой дальнейшее развитие МС ADF4154 для работы с ГУН с максимальной частотой до 6 ГГц. В конце 2005 года была выпущена только опытная серия таких микросхем. Подробной информации в виде data sheets на момент подготовки статьи к печати на сайте компании не было. Основные параметры МС приведены в таблице 1.

ADF4193. Новая быстродействующая МС ФАПЧ с дробным петлевым делителем. Архитектура МС, приведенная на рис. 10, специально разработана под стандарты базовых станций мобильных систем связи GSM и EDGE.

Рис. 10. Структурная схема МС ADF4193
Рис. 10. Структурная схема МС ADF4193

МС отличает высокая точность установки фазы выходного сигнала ГУН: среднеквадратическая ошибка фазы составляет всего 0,5° на частоте 2 ГГц. Отличительной особенностью схемотехники МС является включение в схему входного делителя (помимо делителя R и коммутируемого умножителя D) дополнительного делителя T, применение которого позволяет вдвое увеличить частоту опорного генератора. Результирующий коэффициент деления входного делителя RIN получается равным

где D равно 0 или 1, R лежит в диапазоне 1–15, T — 0 или 1.

Кроме того, в схему введен дополнительный ОУ, позволяющий, например, преобразовать симметричный выход зарядовой помпы в несимметричный.

Рис. 11. Структурная схема двухканальной ФАПЧ ADF4112L
Рис. 11. Структурная схема двухканальной ФАПЧ ADF4112L

ADF4112L открывает серию двухканальных ФАПЧ, номенклатура которых приведена в таблице 2. Структурная схема этой МС приведена на рис. 11. Двухканальные ФАПЧ имеют, как правило, единый вход от опорного генератора (fREF), но различаются по каналам диапазонами частот допустимых к применению ГУН. Эти частоты обозначают fRF (канал RF) и fIF (канал IF). Кроме того, различие заключается в типе петлевых делителей каналов ФАПЧ. В данной МС оба делителя — дробные, реализованные по схеме рис. 7, а их параметры соответствуют параметрам делителя МС ADF4116/4117/4118.

ADF4217L/ADF4218L/ADF4219L представляют собой семейство двухканальных ФАПЧ с дробными петлевыми делителями, структура и параметры которых идентичны ADF4112L. Основные параметры микросхем приведены в таблице 2. Структура микросхем семейства в целом аналогична ADF4112L (рис. 11). Отличительные особенности схемотехники в доступном виде отсутствуют. В целом микросхемы данного семейства относятся к категории малопотребляющих и рекомендуются к применению в мобильной аппаратуре.

ADF4252 представляет собой сдвоенную ФАПЧ и имеет различные типы петлевых делителей в двух каналах: целочисленный делитель в канале IF и дробный делитель в канале RF (рис. 12). Целочисленный делитель канала IF реализован по схеме рис. 7 и имеет коэффициент деления в пределах от 1 до 32 767. Дробный делитель канала RF реализован по схеме рис. 9 и характеризуется следующими параметрами: INT от 31 до 255, MOD от 2 до 4095, FRAC от 0 до (MOD–1).

Рис. 12. Структурная схема ADF4252
Рис. 12. Структурная схема ADF4252

Оба канала микросхемы работают от одного источника опорного сигнала и имеют одинаковую структуру входных целочисленных делителей (как в МС ADF4193), но параметры этих делителей разные: RRF от 1 до 15, RIF от 1 до 32 767, D — 0 или 1.

Микросхемы синтезаторов частоты с ФАПЧ от Analog Devices

Синтезаторы частоты с ФАПЧ представлены семейством из 9 микросхем ADF4360-0/1/2/3/4/5/6/7/8 (табл. 3), реализованных по единой структурной схеме (рис. 13).

Таблица 3. Микросхемы синтезаторов с ФАПЧ Analog Devices
Таблица 3. Микросхемы синтезаторов с ФАПЧ Analog Devices

Схема синтезатора содержит встроенный ГУН, цифровой детектор, выполненный на основе фазового компаратора и зарядовой помпы (см. рис. 4), входной делитель с целочисленным коэффициентом деления R (1–16 383) и петлевой делитель также с целочисленным коэффициентом деления, реализованный по схеме рис. 7. Параметры последнего: Р — 8, 16, 32 и 64; А от 0 до 31, В от 3 до 8191. Схема требует подключения внешнего генератора опорного сигнала с максимальной частотой 250 МГц. Максимальная выходная частота детектора составляет 8 МГц. Напряжение питания всех микросхем однополярное и составляет 3,0–3,6 В. Для уменьшения энергопотребления имеется возможность программируемой установки величины потребляемого тока.

Рис. 13. Структурная схема синтезаторов ADF4360
Рис. 13. Структурная схема синтезаторов ADF4360

Все микросхемы семейства выпускаются в корпусе LPSCP-24. Микросхемы моделей 0/1/2/3/4/5/6 содержат встроенные индуктивности резонансной системы ГУН. Модели 7/8 требуют подключения внешних индуктивностей, для чего предусмотрены соответствующие выводы. Микросхемы семейства различаются только диапазоном сетки выходных частот (табл. 3).

Программные средства разработки

Компания Analog Devices совместно с Applied Radio Labs разработала программу ADIsimPLL для моделирования ФАПЧ и схем на ее основе. Программа содержит библиотеку моделей выпускаемых микросхем ФАПЧ, а также библиотеку моделей популярных схем ГУН, включая ГУН с кварцевой стабилизацией. ADIsimPLL позволяет проектировать петлевые фильтры различной конфигурации, моделировать шумы ГУН, опорного генератора, петли ФАПЧ, воздействие помех и процесс захвата частоты. По окончании процедуры моделирования может быть получен эскизный вариант топологии печатной платы проектируемого устройства. Программа находится в свободном доступе на сайте Analog Devices [4].

Помимо этого, для моделирования ФАПЧ и схем на их основе разработчик может использовать широко известный пакет MathLab (предпочтительно в версии не ниже 6.5).

Литература

  1. Curtin M., O′Brien P. Phase-Locked Loops for High-Frequency Receivers and Transmitters — Part 1. Analog Dialogue, vol. 33, N3, 1999.
  2. Curtin M., O′Brien P. Phase-Locked Loops for High-Frequency Receivers and Transmitters — Part 2. Analog Dialogue, vol. 33, N5, 1999.
  3. Analog Devices PLL/Synthesizer Product Selection Table.2005. www.analog.com
  4. www.analog.com/pll

Скачать статью в формате PDF  Скачать статью Компоненты и технологии PDF

 


Другие статьи по данной теме:

Сообщить об ошибке